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加密加速器核心

允许更快的加密处理SoC设备,Rambus密码算法IP核加速对称和非对称密码,和散列,HMAC-based完整性算法。从侧信道攻击DPA阻力提供强有力的保护。

解决方案 描述
高速AES引擎 可伸缩的、高性能的加密引擎
DPA抗核 图书馆DPA耐对称、非对称和HMAC内核。
基本加密块 图书馆的对称、不对称,HMAC和随机数生成的核心
高速公钥加速器 为完整的可伸缩性和最佳性能设计解决的需求非常高端的密钥生成和密钥交换的解决方案。

加密加速器核心是如何运作的吗

加密加速器核心芯片制造商提供一个容易积分技术无关的soft-macro安全解决方案,提供各种级别的加密加速性能。

他们很容易集成到各种SoC和FPGA的架构和开发流。核心是为了最大化性能与硅面积要求。这些核心通过NIST CAVP向量。微分功率分析(DPA)保护的版本被广泛验证使用标准化的测试向量泄漏评估(TVLA)方法。

加密加速器核心作为RTL提供参考设计,允许顾客目标FPGA CMOS节点或家庭的选择。核心可以集成到任何建筑,如与一个合适的包装SoC巴士汽车附件,或作为内联流媒体加密管道的一部分。testbench设计数据库组成,测试向量,集成数据,仿真和综合脚本,都可以轻松适应匹配一个首选的设计流程和工具链。

介绍边信道攻击的电子书

边信道攻击概论

边信道攻击进行对电子装置相对简单和便宜的来执行。这些攻击包括简单的功率分析(SPA)和微分功率分析(DPA)。所有物理电子系统经常泄漏信息,有效边信道对策应该实现在设计阶段,以确保保护敏感的密钥和数据。

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